/**
 * @file xmc4_gpio_map.h
 * @date 2016-08-22
 *
 * @cond
 *********************************************************************************************************************
 * XMClib v2.1.16 - XMC Peripheral Driver Library 
 *
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 *********************************************************************************************************************
 *
 * Change History
 * --------------
 *
 * 2015-02-20:
 *     - Initial draft<br>
 *      
 * 2015-06-20:
 *     - Updated copyright information
 *
 * 2015-11-12:
 *     - Added XMC4800
 *
 * 2015-06-20:
 *     - Missing CAN_N0_TXD connectivity
 *     - VADC_EMUXn_IN replaced by VADC_EMUX0xy
 *     - DSD_MCLKOUT replaced by DSD_MCLKx
 *     - Missing connectivity for XMC48/47
 *
 * 2015-12-07:
 *     - Add XMC4300 support
 *
 * 2016-03-09:
 *     - Fixed SDMMC signals names
 *     - Added P2_0_AF_CAN_N0_TXD for XMC44xx
 *     - Added P1_9_AF_U0C0_SCLKOUT, P4_7_AF_U2C1_DOUT0, P6_6_AF_U2C0_DOUT0 for XMC47/48 BGA196
 *
 * 2016-03-22:
 *     - Fixed EBU CS signal names
 *
 * 2016-08-22:
 *     - Added P2_0_AF_CAN_N0_TXD for XMC4300
 *
 * @endcond
 *
 * @brief XMC pin mapping definitions
 */

#ifndef XMC4_GPIO_MAP_H
#define XMC4_GPIO_MAP_H

#if (UC_DEVICE == XMC4100) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_9_AF_HRPWM0_OUT31	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX22	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4100) && (UC_PACKAGE == VQFN48)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4104) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
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#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
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#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
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#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4104) && (UC_PACKAGE == VQFN48)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
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#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
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#define P1_5	XMC_GPIO_PORT1, 5
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9


/* Alternate Output Function */
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4108) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P1_0	XMC_GPIO_PORT1, 0
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#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
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#define P2_15	XMC_GPIO_PORT2, 15
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#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX22	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4108) && (UC_PACKAGE == VQFN48)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
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#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4200) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
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#define P0_6	XMC_GPIO_PORT0, 6
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#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_9_AF_HRPWM0_OUT31	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX22	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4200) && (UC_PACKAGE == VQFN48)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4300) && (UC_PACKAGE == LQFP100)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_7	XMC_GPIO_PORT5, 7
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
#define P0_0_AF_ECAT0_PHY_RESET	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_ECAT0_P1_TXD2	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_ECAT0_P1_TXD3	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_ECAT0_LED_ERR	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_ECAT0_LED_RUN	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_ECAT0_P1_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_ECAT0_P0_TXD3	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_ECAT0_P0_TX_ENA	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_6_AF_ECAT0_P0_TXD0	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_ECAT0_P0_TXD1	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_ECAT0_P0_TXD2	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_10_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_10_AF_ECAT0_LED_ERR	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_11_AF_ECAT0_LED_STATE_RUN	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_11_AF_U0C0_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_11_AF_ECAT0_LED_RUN	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_12_AF_ETH0_TX_EN 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_12_AF_CAN_N1_TXD 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_12_AF_ECAT0_P0_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_13_AF_ETH0_TXD0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_13_AF_U0C1_SELO3 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_13_AF_ECAT0_PHY_CLK25	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_14_AF_ETH0_TXD1  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_14_AF_U0C1_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_14_AF_ECAT0_SYNC0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_ETH0_MDC    	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_10_AF_VADC_EMUX10	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_10_AF_ECAT0_PHY_RESET	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_10_AF_ECAT0_SYNC1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_11_AF_CCU80_OUT22	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX12	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_ECAT0_P1_TXD3	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_0_AF_ECAT0_P1_TX_ENA	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_1_AF_ECAT0_P1_TXD0	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_2_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_2_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_ECAT0_P1_TXD1	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_2_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_3_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_3_AF_ECAT0_MCLK  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_4_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_U1C1_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_6_AF_U1C1_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_ECAT0_PHY_CLK25	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_2_AF_ECAT0_P0_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_7_AF_ECAT0_SYNC0 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_12_HWCTRL_ECAT0_MDO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4400) && (UC_PACKAGE == LQFP100)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_7	XMC_GPIO_PORT5, 7
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_9_AF_HRPWM0_OUT31	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_DSD_MCLK2   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_7_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_10_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_11_AF_U0C0_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_11_AF_CCU81_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_12_AF_ETH0_TX_EN 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_12_AF_CAN_N1_TXD 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_12_AF_CCU81_OUT01	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_13_AF_ETH0_TXD0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_13_AF_U0C1_SELO3 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_13_AF_CCU81_OUT20	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_14_AF_ETH0_TXD1  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_14_AF_U0C1_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_14_AF_CCU81_OUT10	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_DSD_MCLK2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_15_AF_CCU81_OUT00	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_CCU81_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_CCU81_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU81_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_ETH0_MDC    	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_10_AF_VADC_EMUX10	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX12	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_0_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_2_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_3_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_3_AF_CCU42_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_4_AF_CCU42_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_DSD_MCLK3   	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_5_AF_U1C1_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_CCU42_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_6_AF_U1C1_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_6_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_15_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4400) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_9_AF_HRPWM0_OUT31	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_DSD_MCLK2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_15_AF_CCU81_OUT00	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_CCU81_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_CCU81_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU81_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_ETH0_MDC    	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_15_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4402) && (UC_PACKAGE == LQFP100)
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#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
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#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
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#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
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#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_14_AF_CCU81_OUT10	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
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#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
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#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_0_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P3_2_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_2_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_3_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_3_AF_CCU42_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_4_AF_CCU42_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_DSD_MCLK3   	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_5_AF_U1C1_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_CCU42_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_6_AF_U1C1_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_6_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_15_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4402) && (UC_PACKAGE == LQFP64)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
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#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
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#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_14	XMC_GPIO_PORT14, 14


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_2_AF_HRPWM0_OUT01	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_HRPWM0_OUT20	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_HRPWM0_OUT21	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_HRPWM0_OUT00	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_HRPWM0_OUT30	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_HRPWM0_OUT11	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_HRPWM0_OUT10	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_9_AF_HRPWM0_OUT31	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_9_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_DSD_MCLK2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_15_AF_CCU81_OUT00	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_U1C0_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_0_AF_CCU81_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_CCU81_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_2_AF_VADC_EMUX00 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_2_AF_CCU81_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_2_AF_CCU41_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_2_AF_LEDTS0_LINE0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_3_AF_VADC_EMUX01 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_3_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_3_AF_CCU41_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_3_AF_LEDTS0_LINE1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_4_AF_VADC_EMUX02 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_4_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_4_AF_LEDTS0_LINE2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_5_AF_CCU41_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_5_AF_LEDTS0_LINE3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_6_AF_CCU80_OUT13 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_6_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_8_AF_CCU80_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_9_AF_LEDTS0_LINE5	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_15_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4500) && (UC_PACKAGE == BGA144)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P0_13	XMC_GPIO_PORT0, 13
#define P0_14	XMC_GPIO_PORT0, 14
#define P0_15	XMC_GPIO_PORT0, 15
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_11	XMC_GPIO_PORT2, 11
#define P2_12	XMC_GPIO_PORT2, 12
#define P2_13	XMC_GPIO_PORT2, 13
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P3_7	XMC_GPIO_PORT3, 7
#define P3_8	XMC_GPIO_PORT3, 8
#define P3_9	XMC_GPIO_PORT3, 9
#define P3_10	XMC_GPIO_PORT3, 10
#define P3_11	XMC_GPIO_PORT3, 11
#define P3_12	XMC_GPIO_PORT3, 12
#define P3_13	XMC_GPIO_PORT3, 13
#define P3_14	XMC_GPIO_PORT3, 14
#define P3_15	XMC_GPIO_PORT3, 15
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P4_2	XMC_GPIO_PORT4, 2
#define P4_3	XMC_GPIO_PORT4, 3
#define P4_4	XMC_GPIO_PORT4, 4
#define P4_5	XMC_GPIO_PORT4, 5
#define P4_6	XMC_GPIO_PORT4, 6
#define P4_7	XMC_GPIO_PORT4, 7
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_3	XMC_GPIO_PORT5, 3
#define P5_4	XMC_GPIO_PORT5, 4
#define P5_5	XMC_GPIO_PORT5, 5
#define P5_6	XMC_GPIO_PORT5, 6
#define P5_7	XMC_GPIO_PORT5, 7
#define P5_8	XMC_GPIO_PORT5, 8
#define P5_9	XMC_GPIO_PORT5, 9
#define P5_10	XMC_GPIO_PORT5, 10
#define P5_11	XMC_GPIO_PORT5, 11
#define P6_0	XMC_GPIO_PORT6, 0
#define P6_1	XMC_GPIO_PORT6, 1
#define P6_2	XMC_GPIO_PORT6, 2
#define P6_3	XMC_GPIO_PORT6, 3
#define P6_4	XMC_GPIO_PORT6, 4
#define P6_5	XMC_GPIO_PORT6, 5
#define P6_6	XMC_GPIO_PORT6, 6
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_4	XMC_GPIO_PORT15, 4
#define P15_5	XMC_GPIO_PORT15, 5
#define P15_6	XMC_GPIO_PORT15, 6
#define P15_7	XMC_GPIO_PORT15, 7
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9
#define P15_12	XMC_GPIO_PORT15, 12
#define P15_13	XMC_GPIO_PORT15, 13
#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_13_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_13_AF_CCU40_OUT2 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_14_AF_U1C0_SELO1 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_15_AF_U1C0_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_DSD_MCLK2   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_CAN_N2_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_10_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
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/* HW control options */
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#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_14_HWCTRL_U1C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_15_HWCTRL_U1C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_11_HWCTRL_EBU_AD29         	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_12_HWCTRL_EBU_AD30         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_13_HWCTRL_DB_ETM_TRACEDATA0	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_13_HWCTRL_EBU_AD31         	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_5_HWCTRL_U2C1_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_10_HWCTRL_LEDTS0_TSIN7     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_4_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_4_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#endif


#if (UC_DEVICE == XMC4500) && (UC_PACKAGE == LQFP100)
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/* Alternate Output Function */
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#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U2C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_U2C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_U2C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_2_HWCTRL_EBU_AD0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_EBU_AD2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_EBU_AD3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_6_HWCTRL_EBU_ADV           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4500) && (UC_PACKAGE == LQFP144)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P0_13	XMC_GPIO_PORT0, 13
#define P0_14	XMC_GPIO_PORT0, 14
#define P0_15	XMC_GPIO_PORT0, 15
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_11	XMC_GPIO_PORT2, 11
#define P2_12	XMC_GPIO_PORT2, 12
#define P2_13	XMC_GPIO_PORT2, 13
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P3_7	XMC_GPIO_PORT3, 7
#define P3_8	XMC_GPIO_PORT3, 8
#define P3_9	XMC_GPIO_PORT3, 9
#define P3_10	XMC_GPIO_PORT3, 10
#define P3_11	XMC_GPIO_PORT3, 11
#define P3_12	XMC_GPIO_PORT3, 12
#define P3_13	XMC_GPIO_PORT3, 13
#define P3_14	XMC_GPIO_PORT3, 14
#define P3_15	XMC_GPIO_PORT3, 15
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P4_2	XMC_GPIO_PORT4, 2
#define P4_3	XMC_GPIO_PORT4, 3
#define P4_4	XMC_GPIO_PORT4, 4
#define P4_5	XMC_GPIO_PORT4, 5
#define P4_6	XMC_GPIO_PORT4, 6
#define P4_7	XMC_GPIO_PORT4, 7
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_3	XMC_GPIO_PORT5, 3
#define P5_4	XMC_GPIO_PORT5, 4
#define P5_5	XMC_GPIO_PORT5, 5
#define P5_6	XMC_GPIO_PORT5, 6
#define P5_7	XMC_GPIO_PORT5, 7
#define P5_8	XMC_GPIO_PORT5, 8
#define P5_9	XMC_GPIO_PORT5, 9
#define P5_10	XMC_GPIO_PORT5, 10
#define P5_11	XMC_GPIO_PORT5, 11
#define P6_0	XMC_GPIO_PORT6, 0
#define P6_1	XMC_GPIO_PORT6, 1
#define P6_2	XMC_GPIO_PORT6, 2
#define P6_3	XMC_GPIO_PORT6, 3
#define P6_4	XMC_GPIO_PORT6, 4
#define P6_5	XMC_GPIO_PORT6, 5
#define P6_6	XMC_GPIO_PORT6, 6
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_4	XMC_GPIO_PORT15, 4
#define P15_5	XMC_GPIO_PORT15, 5
#define P15_6	XMC_GPIO_PORT15, 6
#define P15_7	XMC_GPIO_PORT15, 7
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9
#define P15_12	XMC_GPIO_PORT15, 12
#define P15_13	XMC_GPIO_PORT15, 13
#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_13_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_13_AF_CCU40_OUT2 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_14_AF_U1C0_SELO1 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_15_AF_U1C0_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_DSD_MCLK2   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_CAN_N2_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_10_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_11_AF_U0C0_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_11_AF_CCU81_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_12_AF_ETH0_TX_EN 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P6_5_AF_CCU43_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
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/* HW control options */
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#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_14_HWCTRL_U1C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_15_HWCTRL_U1C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_13_HWCTRL_DB_ETM_TRACEDATA0	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_13_HWCTRL_EBU_AD31         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_5_HWCTRL_U2C1_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_CKE           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_4_HWCTRL_EBU_RAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_4_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_5_HWCTRL_EBU_CAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_5_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_6_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_6_HWCTRL_EBU_A23           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_CS2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_10_HWCTRL_LEDTS0_TSIN7     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_4_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_4_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#endif


#if (UC_DEVICE == XMC4502) && (UC_PACKAGE == LQFP100)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
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#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
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#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P1_0	XMC_GPIO_PORT1, 0
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#define P1_6	XMC_GPIO_PORT1, 6
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#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
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#define P2_10	XMC_GPIO_PORT2, 10
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#define P2_15	XMC_GPIO_PORT2, 15
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#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
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#define P14_4	XMC_GPIO_PORT14, 4
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#define P14_6	XMC_GPIO_PORT14, 6
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#define P14_9	XMC_GPIO_PORT14, 9
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#define P14_13	XMC_GPIO_PORT14, 13
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#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
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#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
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#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_DSD_MCLK2   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_CAN_N2_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_11_AF_U0C0_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_11_AF_CCU81_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_12_AF_CAN_N1_TXD 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_12_AF_CCU81_OUT01	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_13_AF_U0C1_SELO3 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_13_AF_CCU81_OUT20	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_14_AF_U0C1_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_14_AF_CCU81_OUT10	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P1_15_AF_CCU81_OUT00	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_CCU81_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P2_7_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_7_AF_CCU80_OUT03 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_7_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
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#define P2_8_AF_LEDTS0_LINE4	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_10_AF_VADC_EMUX10	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_14_AF_VADC_EMUX11	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P2_14_AF_CCU80_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_VADC_EMUX12	XMC_GPIO_MODE_OUTPUT_ALT1
#define P2_15_AF_CCU80_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_15_AF_LEDTS0_LINE6	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_0_AF_U2C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_0_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_0_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_2_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_2_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_3_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_3_AF_CCU42_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_U2C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_4_AF_U1C1_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_4_AF_CCU42_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_4_AF_DSD_MCLK3   	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_5_AF_U2C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_5_AF_U1C1_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_CCU42_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_6_AF_U2C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_6_AF_U1C1_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_6_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U2C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_U2C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_U2C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_2_HWCTRL_EBU_AD0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_EBU_AD2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_EBU_AD3           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4504) && (UC_PACKAGE == LQFP100)
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/* Alternate Output Function */
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#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U2C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_U2C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_U2C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_2_HWCTRL_EBU_AD0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_EBU_AD2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_EBU_AD3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_6_HWCTRL_EBU_ADV           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4504) && (UC_PACKAGE == LQFP144)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P0_13	XMC_GPIO_PORT0, 13
#define P0_14	XMC_GPIO_PORT0, 14
#define P0_15	XMC_GPIO_PORT0, 15
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_11	XMC_GPIO_PORT2, 11
#define P2_12	XMC_GPIO_PORT2, 12
#define P2_13	XMC_GPIO_PORT2, 13
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P3_7	XMC_GPIO_PORT3, 7
#define P3_8	XMC_GPIO_PORT3, 8
#define P3_9	XMC_GPIO_PORT3, 9
#define P3_10	XMC_GPIO_PORT3, 10
#define P3_11	XMC_GPIO_PORT3, 11
#define P3_12	XMC_GPIO_PORT3, 12
#define P3_13	XMC_GPIO_PORT3, 13
#define P3_14	XMC_GPIO_PORT3, 14
#define P3_15	XMC_GPIO_PORT3, 15
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P4_2	XMC_GPIO_PORT4, 2
#define P4_3	XMC_GPIO_PORT4, 3
#define P4_4	XMC_GPIO_PORT4, 4
#define P4_5	XMC_GPIO_PORT4, 5
#define P4_6	XMC_GPIO_PORT4, 6
#define P4_7	XMC_GPIO_PORT4, 7
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_3	XMC_GPIO_PORT5, 3
#define P5_4	XMC_GPIO_PORT5, 4
#define P5_5	XMC_GPIO_PORT5, 5
#define P5_6	XMC_GPIO_PORT5, 6
#define P5_7	XMC_GPIO_PORT5, 7
#define P5_8	XMC_GPIO_PORT5, 8
#define P5_9	XMC_GPIO_PORT5, 9
#define P5_10	XMC_GPIO_PORT5, 10
#define P5_11	XMC_GPIO_PORT5, 11
#define P6_0	XMC_GPIO_PORT6, 0
#define P6_1	XMC_GPIO_PORT6, 1
#define P6_2	XMC_GPIO_PORT6, 2
#define P6_3	XMC_GPIO_PORT6, 3
#define P6_4	XMC_GPIO_PORT6, 4
#define P6_5	XMC_GPIO_PORT6, 5
#define P6_6	XMC_GPIO_PORT6, 6
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_4	XMC_GPIO_PORT15, 4
#define P15_5	XMC_GPIO_PORT15, 5
#define P15_6	XMC_GPIO_PORT15, 6
#define P15_7	XMC_GPIO_PORT15, 7
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9
#define P15_12	XMC_GPIO_PORT15, 12
#define P15_13	XMC_GPIO_PORT15, 13
#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_13_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_13_AF_CCU40_OUT2 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_14_AF_U1C0_SELO1 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_15_AF_U1C0_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_7_AF_DSD_MCLK2   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_8_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_8_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_9_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_10_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_11_AF_U0C0_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_11_AF_CCU81_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_12_AF_CCU81_OUT01	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_13_AF_U0C1_SELO3 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_13_AF_CCU81_OUT20	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_14_AF_U0C1_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_14_AF_CCU81_OUT10	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_15_AF_SCU_EXTCLK 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_15_AF_DSD_MCLK2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_15_AF_CCU81_OUT00	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_CCU81_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P2_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P2_0_AF_LEDTS0_COL1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P2_1_AF_CCU81_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P2_1_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
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/* HW control options */
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#define P0_15_HWCTRL_U1C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_CKE           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_4_HWCTRL_EBU_RAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P5_5_HWCTRL_EBU_CAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_5_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P5_6_HWCTRL_EBU_A23           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
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#if (UC_DEVICE == XMC4700) && (UC_PACKAGE == BGA196)
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#define P15_14	XMC_GPIO_PORT15, 14
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/* Alternate Output Function */
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/* HW control options */
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#define P0_14_HWCTRL_U1C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P5_8_HWCTRL_EBU_CS2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P7_0_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_1_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_2_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_3_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_8_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_0_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_1_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P8_3_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4700) && (UC_PACKAGE == LQFP100)
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#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
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#define P3_5_AF_U1C1_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_5_AF_CCU42_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_5_AF_U0C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P3_6_AF_U2C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P3_6_AF_U1C1_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P3_6_AF_CCU42_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P3_6_AF_U0C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_0_AF_CAN_N3_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P4_0_AF_DSD_MCLK1   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_0_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P4_1_AF_U2C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P4_1_AF_U1C1_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P4_1_AF_DSD_MCLK0   	XMC_GPIO_MODE_OUTPUT_ALT3
#define P4_1_AF_U0C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_0_AF_U2C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_0_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_0_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P5_1_AF_CCU81_OUT32 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_1_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_2_AF_U2C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P5_2_AF_CCU81_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_2_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P5_7_AF_CCU81_OUT02 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P5_7_AF_LEDTS0_COLA 	XMC_GPIO_MODE_OUTPUT_ALT4

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_2_HWCTRL_EBU_AD0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_EBU_AD2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_EBU_AD3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_6_HWCTRL_EBU_ADV           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4700) && (UC_PACKAGE == LQFP144)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P0_13	XMC_GPIO_PORT0, 13
#define P0_14	XMC_GPIO_PORT0, 14
#define P0_15	XMC_GPIO_PORT0, 15
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_11	XMC_GPIO_PORT2, 11
#define P2_12	XMC_GPIO_PORT2, 12
#define P2_13	XMC_GPIO_PORT2, 13
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P3_7	XMC_GPIO_PORT3, 7
#define P3_8	XMC_GPIO_PORT3, 8
#define P3_9	XMC_GPIO_PORT3, 9
#define P3_10	XMC_GPIO_PORT3, 10
#define P3_11	XMC_GPIO_PORT3, 11
#define P3_12	XMC_GPIO_PORT3, 12
#define P3_13	XMC_GPIO_PORT3, 13
#define P3_14	XMC_GPIO_PORT3, 14
#define P3_15	XMC_GPIO_PORT3, 15
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P4_2	XMC_GPIO_PORT4, 2
#define P4_3	XMC_GPIO_PORT4, 3
#define P4_4	XMC_GPIO_PORT4, 4
#define P4_5	XMC_GPIO_PORT4, 5
#define P4_6	XMC_GPIO_PORT4, 6
#define P4_7	XMC_GPIO_PORT4, 7
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_3	XMC_GPIO_PORT5, 3
#define P5_4	XMC_GPIO_PORT5, 4
#define P5_5	XMC_GPIO_PORT5, 5
#define P5_6	XMC_GPIO_PORT5, 6
#define P5_7	XMC_GPIO_PORT5, 7
#define P5_8	XMC_GPIO_PORT5, 8
#define P5_9	XMC_GPIO_PORT5, 9
#define P5_10	XMC_GPIO_PORT5, 10
#define P5_11	XMC_GPIO_PORT5, 11
#define P6_0	XMC_GPIO_PORT6, 0
#define P6_1	XMC_GPIO_PORT6, 1
#define P6_2	XMC_GPIO_PORT6, 2
#define P6_3	XMC_GPIO_PORT6, 3
#define P6_4	XMC_GPIO_PORT6, 4
#define P6_5	XMC_GPIO_PORT6, 5
#define P6_6	XMC_GPIO_PORT6, 6
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_4	XMC_GPIO_PORT15, 4
#define P15_5	XMC_GPIO_PORT15, 5
#define P15_6	XMC_GPIO_PORT15, 6
#define P15_7	XMC_GPIO_PORT15, 7
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9
#define P15_12	XMC_GPIO_PORT15, 12
#define P15_13	XMC_GPIO_PORT15, 13
#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_13_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_13_AF_CCU40_OUT2 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_14_AF_U1C0_SELO1 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_15_AF_U1C0_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_3_AF_CCU40_OUT0  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_3_AF_ERU1_PDOUT0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_4_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_4_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_4_AF_CCU80_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_4_AF_CCU81_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_5_AF_CAN_N1_TXD  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_5_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_5_AF_CCU80_OUT23 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_5_AF_CCU81_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_6_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
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/* HW control options */
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#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_14_HWCTRL_U1C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_15_HWCTRL_U1C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_11_HWCTRL_DB_ETM_TRACEDATA2	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_11_HWCTRL_EBU_AD29         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_12_HWCTRL_DB_ETM_TRACEDATA1	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_12_HWCTRL_EBU_AD30         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_13_HWCTRL_DB_ETM_TRACEDATA0	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_13_HWCTRL_EBU_AD31         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_5_HWCTRL_U2C1_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_CKE           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_4_HWCTRL_EBU_RAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_4_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_5_HWCTRL_EBU_CAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_5_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_6_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_6_HWCTRL_EBU_A23           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_CS2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_10_HWCTRL_LEDTS0_TSIN7     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_4_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_4_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#endif


#if (UC_DEVICE == XMC4800) && (UC_PACKAGE == BGA196)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
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#define P0_10	XMC_GPIO_PORT0, 10
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#define P0_12	XMC_GPIO_PORT0, 12
#define P0_13	XMC_GPIO_PORT0, 13
#define P0_14	XMC_GPIO_PORT0, 14
#define P0_15	XMC_GPIO_PORT0, 15
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#define P1_11	XMC_GPIO_PORT1, 11
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#define P2_11	XMC_GPIO_PORT2, 11
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#define P2_13	XMC_GPIO_PORT2, 13
#define P2_14	XMC_GPIO_PORT2, 14
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#define P3_8	XMC_GPIO_PORT3, 8
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#define P3_10	XMC_GPIO_PORT3, 10
#define P3_11	XMC_GPIO_PORT3, 11
#define P3_12	XMC_GPIO_PORT3, 12
#define P3_13	XMC_GPIO_PORT3, 13
#define P3_14	XMC_GPIO_PORT3, 14
#define P3_15	XMC_GPIO_PORT3, 15
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#define P5_5	XMC_GPIO_PORT5, 5
#define P5_6	XMC_GPIO_PORT5, 6
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#define P7_4	XMC_GPIO_PORT7, 4
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#define P8_11	XMC_GPIO_PORT8, 11
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#define P9_11	XMC_GPIO_PORT9, 11
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#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
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#define P15_7	XMC_GPIO_PORT15, 7
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9
#define P15_12	XMC_GPIO_PORT15, 12
#define P15_13	XMC_GPIO_PORT15, 13
#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
#define P0_0_AF_ECAT0_PHY_RESET	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_1_AF_U1C1_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_1_AF_LEDTS0_COL3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_2_AF_ECAT0_P1_TXD2	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_2_AF_U1C1_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_2_AF_CCU80_OUT01 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_3_AF_ECAT0_P1_TXD3	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_3_AF_CCU80_OUT20 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_4_AF_ETH0_TX_EN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_4_AF_CCU80_OUT10 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_5_AF_ETH0_TXD0   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_5_AF_U1C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_5_AF_CCU80_OUT00 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_6_AF_ETH0_TXD1   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_6_AF_U1C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_6_AF_CCU80_OUT30 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_7_AF_WDT_REQUEST 	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_7_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_7_AF_ECAT0_LED_ERR	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_8_AF_SCU_EXTCLK  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_8_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_8_AF_ECAT0_LED_RUN	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_U1C1_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_9_AF_CCU80_OUT12 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_9_AF_LEDTS0_COL0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_10_AF_ETH0_MDC   	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_10_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_10_AF_CCU80_OUT02	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_10_AF_LEDTS0_COL1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_11_AF_ECAT0_P1_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_11_AF_U1C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_11_AF_CCU80_OUT31	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_12_AF_U1C1_SELO0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_12_AF_CCU40_OUT3 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_13_AF_U1C1_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_13_AF_CCU40_OUT2 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_14_AF_U1C0_SELO1 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_15_AF_U1C0_SELO2 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_0_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_0_AF_ERU1_PDOUT3 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_1_AF_DSD_CGPWMP  	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_1_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P1_1_AF_CCU40_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_1_AF_ERU1_PDOUT2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_2_AF_ECAT0_P0_TXD3	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_2_AF_CCU40_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P1_2_AF_ERU1_PDOUT1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P1_3_AF_ECAT0_P0_TX_ENA	XMC_GPIO_MODE_OUTPUT_ALT1
#define P1_3_AF_U0C0_MCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P7_6_AF_CCU42_OUT2  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P7_7_AF_CCU42_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
#define P7_8_AF_CAN_N5_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P7_8_AF_ECAT0_P0_TX_ENA	XMC_GPIO_MODE_OUTPUT_ALT4
#define P7_9_AF_CCU80_OUT22 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P7_10_AF_CCU80_OUT32	XMC_GPIO_MODE_OUTPUT_ALT3
#define P7_11_AF_CCU80_OUT33	XMC_GPIO_MODE_OUTPUT_ALT3
#define P8_0_AF_ECAT0_P1_TXD0	XMC_GPIO_MODE_OUTPUT_ALT4
#define P8_1_AF_ECAT0_P1_TXD1	XMC_GPIO_MODE_OUTPUT_ALT4
#define P8_2_AF_ECAT0_P1_TXD2	XMC_GPIO_MODE_OUTPUT_ALT4
#define P8_3_AF_ECAT0_P1_TXD3	XMC_GPIO_MODE_OUTPUT_ALT4
#define P8_4_AF_U0C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P8_5_AF_U0C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P8_6_AF_U0C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P8_7_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P8_8_AF_ECAT0_P1_TX_ENA	XMC_GPIO_MODE_OUTPUT_ALT4
#define P8_9_AF_CCU81_OUT33 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P8_10_AF_CCU81_OUT21	XMC_GPIO_MODE_OUTPUT_ALT3
#define P8_11_AF_CCU81_OUT11	XMC_GPIO_MODE_OUTPUT_ALT3
#define P9_0_AF_U2C0_SELO0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_0_AF_ECAT0_SYNC0 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_1_AF_U2C0_SCLKOUT	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_1_AF_ECAT0_SYNC1 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_2_AF_U2C0_SELO1  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_2_AF_ECAT0_PHY_RESET	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_3_AF_U2C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_3_AF_ECAT0_PHY_CLK25	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_4_AF_ECAT0_LED_STATE_RUN	XMC_GPIO_MODE_OUTPUT_ALT1
#define P9_4_AF_ECAT0_LED_RUN	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_5_AF_U2C0_SELO2  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_5_AF_ECAT0_LED_ERR	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_6_AF_U2C0_SELO3  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_6_AF_ECAT0_MCLK  	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_7_AF_U2C0_SELO4  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_8_AF_ECAT0_P0_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_9_AF_ECAT0_P1_LED_LINK_ACT	XMC_GPIO_MODE_OUTPUT_ALT4
#define P9_10_AF_U2C1_DOUT0 	XMC_GPIO_MODE_OUTPUT_ALT2
#define P9_11_AF_U2C1_SELO3 	XMC_GPIO_MODE_OUTPUT_ALT2

/* HW control options */
#define P0_2_HWCTRL_U1C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_2_HWCTRL_EBU_AD0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_4_HWCTRL_U1C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_4_HWCTRL_EBU_AD2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_5_HWCTRL_EBU_AD3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_6_HWCTRL_EBU_ADV           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_ECAT0_MDO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_14_HWCTRL_U1C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_15_HWCTRL_U1C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_7_HWCTRL_EBU_AD11          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_8_HWCTRL_EBU_AD12          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_11_HWCTRL_DB_ETM_TRACEDATA2	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_11_HWCTRL_EBU_AD29         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_12_HWCTRL_DB_ETM_TRACEDATA1	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_12_HWCTRL_EBU_AD30         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_13_HWCTRL_DB_ETM_TRACEDATA0	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_13_HWCTRL_EBU_AD31         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_2_HWCTRL_ECAT0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_5_HWCTRL_U2C1_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_CKE           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_4_HWCTRL_EBU_RAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_4_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_5_HWCTRL_EBU_CAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_5_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_6_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_6_HWCTRL_EBU_A23           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_CS2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_10_HWCTRL_LEDTS0_TSIN7     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_4_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_4_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P7_0_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_1_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_2_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_3_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P7_8_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_0_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_1_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P8_3_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P9_7_HWCTRL_ECAT0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4800) && (UC_PACKAGE == LQFP100)
#define P0_0	XMC_GPIO_PORT0, 0
#define P0_1	XMC_GPIO_PORT0, 1
#define P0_2	XMC_GPIO_PORT0, 2
#define P0_3	XMC_GPIO_PORT0, 3
#define P0_4	XMC_GPIO_PORT0, 4
#define P0_5	XMC_GPIO_PORT0, 5
#define P0_6	XMC_GPIO_PORT0, 6
#define P0_7	XMC_GPIO_PORT0, 7
#define P0_8	XMC_GPIO_PORT0, 8
#define P0_9	XMC_GPIO_PORT0, 9
#define P0_10	XMC_GPIO_PORT0, 10
#define P0_11	XMC_GPIO_PORT0, 11
#define P0_12	XMC_GPIO_PORT0, 12
#define P1_0	XMC_GPIO_PORT1, 0
#define P1_1	XMC_GPIO_PORT1, 1
#define P1_2	XMC_GPIO_PORT1, 2
#define P1_3	XMC_GPIO_PORT1, 3
#define P1_4	XMC_GPIO_PORT1, 4
#define P1_5	XMC_GPIO_PORT1, 5
#define P1_6	XMC_GPIO_PORT1, 6
#define P1_7	XMC_GPIO_PORT1, 7
#define P1_8	XMC_GPIO_PORT1, 8
#define P1_9	XMC_GPIO_PORT1, 9
#define P1_10	XMC_GPIO_PORT1, 10
#define P1_11	XMC_GPIO_PORT1, 11
#define P1_12	XMC_GPIO_PORT1, 12
#define P1_13	XMC_GPIO_PORT1, 13
#define P1_14	XMC_GPIO_PORT1, 14
#define P1_15	XMC_GPIO_PORT1, 15
#define P2_0	XMC_GPIO_PORT2, 0
#define P2_1	XMC_GPIO_PORT2, 1
#define P2_2	XMC_GPIO_PORT2, 2
#define P2_3	XMC_GPIO_PORT2, 3
#define P2_4	XMC_GPIO_PORT2, 4
#define P2_5	XMC_GPIO_PORT2, 5
#define P2_6	XMC_GPIO_PORT2, 6
#define P2_7	XMC_GPIO_PORT2, 7
#define P2_8	XMC_GPIO_PORT2, 8
#define P2_9	XMC_GPIO_PORT2, 9
#define P2_10	XMC_GPIO_PORT2, 10
#define P2_14	XMC_GPIO_PORT2, 14
#define P2_15	XMC_GPIO_PORT2, 15
#define P3_0	XMC_GPIO_PORT3, 0
#define P3_1	XMC_GPIO_PORT3, 1
#define P3_2	XMC_GPIO_PORT3, 2
#define P3_3	XMC_GPIO_PORT3, 3
#define P3_4	XMC_GPIO_PORT3, 4
#define P3_5	XMC_GPIO_PORT3, 5
#define P3_6	XMC_GPIO_PORT3, 6
#define P4_0	XMC_GPIO_PORT4, 0
#define P4_1	XMC_GPIO_PORT4, 1
#define P5_0	XMC_GPIO_PORT5, 0
#define P5_1	XMC_GPIO_PORT5, 1
#define P5_2	XMC_GPIO_PORT5, 2
#define P5_7	XMC_GPIO_PORT5, 7
#define P14_0	XMC_GPIO_PORT14, 0
#define P14_1	XMC_GPIO_PORT14, 1
#define P14_2	XMC_GPIO_PORT14, 2
#define P14_3	XMC_GPIO_PORT14, 3
#define P14_4	XMC_GPIO_PORT14, 4
#define P14_5	XMC_GPIO_PORT14, 5
#define P14_6	XMC_GPIO_PORT14, 6
#define P14_7	XMC_GPIO_PORT14, 7
#define P14_8	XMC_GPIO_PORT14, 8
#define P14_9	XMC_GPIO_PORT14, 9
#define P14_12	XMC_GPIO_PORT14, 12
#define P14_13	XMC_GPIO_PORT14, 13
#define P14_14	XMC_GPIO_PORT14, 14
#define P14_15	XMC_GPIO_PORT14, 15
#define P15_2	XMC_GPIO_PORT15, 2
#define P15_3	XMC_GPIO_PORT15, 3
#define P15_8	XMC_GPIO_PORT15, 8
#define P15_9	XMC_GPIO_PORT15, 9


/* Alternate Output Function */
#define P0_0_AF_ECAT0_PHY_RESET	XMC_GPIO_MODE_OUTPUT_ALT1
#define P0_0_AF_CAN_N0_TXD  	XMC_GPIO_MODE_OUTPUT_ALT2
#define P0_0_AF_CCU80_OUT21 	XMC_GPIO_MODE_OUTPUT_ALT3
#define P0_0_AF_LEDTS0_COL2 	XMC_GPIO_MODE_OUTPUT_ALT4
#define P0_1_AF_USB_DRIVEVBUS	XMC_GPIO_MODE_OUTPUT_ALT1
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#define P0_1_AF_CCU80_OUT11 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P5_0_AF_DSD_CGPWMN  	XMC_GPIO_MODE_OUTPUT_ALT2
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#define P5_1_AF_U0C0_DOUT0  	XMC_GPIO_MODE_OUTPUT_ALT1
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/* HW control options */
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#define P0_3_HWCTRL_U1C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_3_HWCTRL_EBU_AD1           	XMC_GPIO_HWCTRL_PERIPHERAL2
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#define P0_5_HWCTRL_U1C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P0_7_HWCTRL_EBU_AD6           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_8_HWCTRL_EBU_AD7           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_9_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_9_HWCTRL_EBU_CS1           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_11_HWCTRL_SDMMC_RESET      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_11_HWCTRL_EBU_BREQ         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P0_12_HWCTRL_ECAT0_MDO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P0_12_HWCTRL_EBU_HLDA_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_2_HWCTRL_U0C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_2_HWCTRL_EBU_AD14          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_3_HWCTRL_U0C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_3_HWCTRL_EBU_AD15          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_4_HWCTRL_U0C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_5_HWCTRL_U0C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_SDMMC_DATA_OUT1   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_6_HWCTRL_EBU_AD10          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_7_HWCTRL_SDMMC_DATA_OUT2   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_8_HWCTRL_SDMMC_DATA_OUT4   	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P1_9_HWCTRL_SDMMC_DATA_OUT5   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_9_HWCTRL_EBU_AD13          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_11_HWCTRL_ETH0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_SDMMC_DATA_OUT6  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_12_HWCTRL_EBU_AD16         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P1_13_HWCTRL_EBU_AD17         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_14_HWCTRL_EBU_AD18         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P1_15_HWCTRL_EBU_AD19         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_0_HWCTRL_ETH0_MDO          	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_0_HWCTRL_EBU_AD20          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_1_HWCTRL_DB_TDO_TRACESWO   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_1_HWCTRL_EBU_AD21          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_2_HWCTRL_LEDTS0_TSIN0      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_2_HWCTRL_EBU_AD22          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_3_HWCTRL_LEDTS0_TSIN1      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_3_HWCTRL_EBU_AD23          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_4_HWCTRL_EBU_AD24          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_EBU_AD26          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_9_HWCTRL_LEDTS0_TSIN5      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_9_HWCTRL_EBU_AD27          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_10_HWCTRL_DB_ETM_TRACEDATA3	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_10_HWCTRL_EBU_AD28         	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_14_HWCTRL_DB_ETM_TRACECLK  	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_14_HWCTRL_EBU_BC0          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_15_HWCTRL_LEDTS0_TSIN6     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_15_HWCTRL_EBU_BC1          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_0_HWCTRL_EBU_RD            	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_1_HWCTRL_EBU_RD_NWR        	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_2_HWCTRL_EBU_CS0           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#endif


#if (UC_DEVICE == XMC4800) && (UC_PACKAGE == LQFP144)
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#define P1_11	XMC_GPIO_PORT1, 11
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#define P15_14	XMC_GPIO_PORT15, 14
#define P15_15	XMC_GPIO_PORT15, 15


/* Alternate Output Function */
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#define P0_14_AF_CCU40_OUT1 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P0_15_AF_CCU40_OUT0 	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P1_0_AF_CCU40_OUT3  	XMC_GPIO_MODE_OUTPUT_ALT3
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#define P2_4_AF_CCU41_OUT1  	XMC_GPIO_MODE_OUTPUT_ALT3
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/* HW control options */
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#define P1_13_HWCTRL_SDMMC_DATA_OUT7  	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_4_HWCTRL_LEDTS0_TSIN2      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P2_5_HWCTRL_LEDTS0_TSIN3      	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_5_HWCTRL_EBU_AD25          	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P2_6_HWCTRL_U2C0_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P2_8_HWCTRL_LEDTS0_TSIN4      	XMC_GPIO_HWCTRL_PERIPHERAL1
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#define P3_3_HWCTRL_SDMMC_LED         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_4_HWCTRL_SDMMC_BUS_POWER   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_SDMMC_CMD_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_5_HWCTRL_EBU_AD4           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_6_HWCTRL_SDMMC_CLK_OUT     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_6_HWCTRL_EBU_AD5           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P3_10_HWCTRL_U0C1_DOUT3       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_11_HWCTRL_U0C1_DOUT2       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_12_HWCTRL_U0C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_13_HWCTRL_U0C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_14_HWCTRL_U1C1_DOUT1       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P3_15_HWCTRL_U1C1_DOUT0       	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_SDMMC_DATA_OUT0   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_0_HWCTRL_EBU_AD8           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_1_HWCTRL_SDMMC_DATA_OUT3   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_1_HWCTRL_EBU_AD9           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P4_2_HWCTRL_ECAT0_MDO         	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_4_HWCTRL_U2C1_DOUT3        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_5_HWCTRL_U2C1_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_6_HWCTRL_U2C1_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P4_7_HWCTRL_U2C1_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_0_HWCTRL_U2C0_DOUT0        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_1_HWCTRL_U2C0_DOUT1        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_CKE           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_3_HWCTRL_EBU_A20           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_4_HWCTRL_EBU_RAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_4_HWCTRL_EBU_A21           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_5_HWCTRL_EBU_CAS           	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_5_HWCTRL_EBU_A22           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_6_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_6_HWCTRL_EBU_A23           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_7_HWCTRL_U2C0_DOUT2        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_8_HWCTRL_EBU_CS2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_9_HWCTRL_EBU_BFCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P5_9_HWCTRL_EBU_CS3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P5_10_HWCTRL_LEDTS0_TSIN7     	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_DB_ETM_TRACECLK   	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_0_HWCTRL_EBU_A16           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_1_HWCTRL_DB_ETM_TRACEDATA3 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_1_HWCTRL_EBU_A17           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_2_HWCTRL_DB_ETM_TRACEDATA2 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_2_HWCTRL_EBU_A18           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_4_HWCTRL_EBU_SDCLKO        	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_4_HWCTRL_EBU_A19           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_5_HWCTRL_DB_ETM_TRACEDATA1 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_5_HWCTRL_EBU_BC2           	XMC_GPIO_HWCTRL_PERIPHERAL2
#define P6_6_HWCTRL_DB_ETM_TRACEDATA0 	XMC_GPIO_HWCTRL_PERIPHERAL1
#define P6_6_HWCTRL_EBU_BC3           	XMC_GPIO_HWCTRL_PERIPHERAL2
#endif

#endif /* XMC4_GPIO_MAP_H */
